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36e8ae9df1
commit
2d40126e59
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@ -66,7 +66,7 @@ def get_common_ios():
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("pll_locked", 0, Pins(1)),
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("pll_locked", 0, Pins(1)),
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# init status
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# init status
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("init_done", 0, Pins(1)),
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("init_done", 0, Pins(1)),
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("init_error", 0, Pins(1)),
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("init_error", 0, Pins(1)),
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# iodelay clk / rst
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# iodelay clk / rst
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@ -82,20 +82,20 @@ def get_dram_ios(core_config):
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sdram_module = core_config["sdram_module"]
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sdram_module = core_config["sdram_module"]
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return [
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return [
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("ddram", 0,
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("ddram", 0,
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Subsignal("a", Pins(log2_int(core_config["sdram_module"].nrows))),
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Subsignal("a", Pins(log2_int(core_config["sdram_module"].nrows))),
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Subsignal("ba", Pins(log2_int(core_config["sdram_module"].nbanks))),
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Subsignal("ba", Pins(log2_int(core_config["sdram_module"].nbanks))),
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||||||
Subsignal("ras_n", Pins(1)),
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Subsignal("ras_n", Pins(1)),
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Subsignal("cas_n", Pins(1)),
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Subsignal("cas_n", Pins(1)),
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Subsignal("we_n", Pins(1)),
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Subsignal("we_n", Pins(1)),
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Subsignal("cs_n", Pins(core_config["sdram_rank_nb"])),
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Subsignal("cs_n", Pins(core_config["sdram_rank_nb"])),
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Subsignal("dm", Pins(core_config["sdram_module_nb"])),
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Subsignal("dm", Pins(core_config["sdram_module_nb"])),
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Subsignal("dq", Pins(8*core_config["sdram_module_nb"])),
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Subsignal("dq", Pins(8*core_config["sdram_module_nb"])),
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Subsignal("dqs_p", Pins(core_config["sdram_module_nb"])),
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Subsignal("dqs_p", Pins(core_config["sdram_module_nb"])),
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Subsignal("dqs_n", Pins(core_config["sdram_module_nb"])),
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Subsignal("dqs_n", Pins(core_config["sdram_module_nb"])),
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Subsignal("clk_p", Pins(core_config["sdram_rank_nb"])),
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Subsignal("clk_p", Pins(core_config["sdram_rank_nb"])),
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Subsignal("clk_n", Pins(core_config["sdram_rank_nb"])),
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Subsignal("clk_n", Pins(core_config["sdram_rank_nb"])),
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||||||
Subsignal("cke", Pins(core_config["sdram_rank_nb"])),
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Subsignal("cke", Pins(core_config["sdram_rank_nb"])),
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||||||
Subsignal("odt", Pins(core_config["sdram_rank_nb"])),
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Subsignal("odt", Pins(core_config["sdram_rank_nb"])),
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Subsignal("reset_n", Pins(1))
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Subsignal("reset_n", Pins(1))
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),
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),
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]
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]
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