targets/Ultrascale(+): enable USDDRPHY_DEBUG.
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4053c02d7e
commit
555bf6c4dc
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@ -68,6 +68,7 @@ class BaseSoC(SoCCore):
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cmd_latency = 0)
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self.add_csr("ddrphy")
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self.add_constant("USDDRPHY", None)
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self.add_constant("USDDRPHY_DEBUG", None)
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self.add_sdram("sdram",
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phy = self.ddrphy,
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module = EDY4016A(sys_clk_freq, "1:4"),
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@ -67,6 +67,7 @@ class BaseSoC(SoCCore):
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cmd_latency = 0)
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self.add_csr("ddrphy")
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||||
self.add_constant("USDDRPHY", None)
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self.add_constant("USDDRPHY_DEBUG", None)
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||||
self.add_sdram("sdram",
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phy = self.ddrphy,
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module = MT40A256M16(sys_clk_freq, "1:4"),
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@ -67,6 +67,7 @@ class BaseSoC(SoCCore):
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cmd_latency = 0)
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self.add_csr("ddrphy")
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||||
self.add_constant("USDDRPHY", None)
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||||
self.add_constant("USDDRPHY_DEBUG", None)
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||||
self.add_sdram("sdram",
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phy = self.ddrphy,
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module = EDY4016A(sys_clk_freq, "1:4"),
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@ -66,6 +66,7 @@ class BaseSoC(SoCCore):
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cmd_latency = 1)
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self.add_csr("ddrphy")
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||||
self.add_constant("USDDRPHY", None)
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self.add_constant("USDDRPHY_DEBUG", None)
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||||
self.add_sdram("sdram",
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phy = self.ddrphy,
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module = KVR21SE15S84(sys_clk_freq, "1:4"),
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